To The Moon

小虎們好~

7月3日，華為董事、半導體業務總裁何庭波在中國科學院科技論文預發布平臺ChinaXiv正式上線《面向多層級電子系統的時間縮微理論》V2版本。這是該理論自5月25日首次公開發布以來的首次重大版本更新。[Smart]

一篇專業論文的更新如此受關注，是因為V2版本完成了從「思想綱領」到「硅片實證」的關鍵跨越——這不再是一個學術概念，而是一條已經被量產芯片驗證過的產業路徑。

一、什麼是「韜定律」？從「幾何縮微」到「時間縮微」

「韜（τ）定律」是華為提出的半導體與電子系統演進的新指導原則。

τ是希臘字母，在電路理論中代表時間常數——信號從一種狀態切換到另一種狀態所需的時間。τ越小，電路切換越快、系統效率越高。

摩爾定律的核心是「幾何縮微」——把晶體管越做越小。而韜定律的核心是「時間縮微」——不再單純依賴縮小晶體管尺寸，而是通過系統性降低時間常數τ，持續壓縮芯片內部信號的傳播時延，從而實現晶體管密度和系統性能的不斷提升。

具體路徑包括邏輯摺疊（Logic Folding）、三維堆疊、先進封裝等系統級架構創新，在晶體管、電路、芯片、系統四個層面持續壓縮信號傳輸延遲。

這是中國首次在全球半導體領域提出具有普遍指導意義的產業演進原則，標誌著中國從「規則接受者」向「規則制定者」的角色轉變。

（摩爾定律 vs 新縮微理論對比圖）

二、V2升級了什麼？爲什麼這麼受關注？

（昇騰/Ascend芯片架構圖）

如果說5月的V1版本是「拋出理念框架」，那麼V2版本就是一次硬核的「交作業」。但對於投資者來說，不必糾結於技術細節，只需抓住三個核心要點：

要點一：同樣製程，性能躍升一至兩代

以往行業慣例是「換製程=換性能」——從7nm到5nm，晶體管密度提升約30%-40%，通常需要2至3年。但麒麟2026用同一製程節點，僅通過架構重構，就實現了晶體管密度提升55%、等性能功耗降低41%。

對投資者而言，這意味著華為找到了一條不依賴EUV光刻機也能持續升級芯片性能的路徑。在先進製程設備被封鎖的背景下，這個突破的戰略意義怎麼強調都不為過。這是一條繞開設備封鎖、依靠架構創新實現「彎道超車」的可行路線。[YoYo]

要點二：目前的提升只是「保守版本」

論文特別說明，當前的混合鍵合間距為1.5微米，摺疊只應用於部分關鍵路徑，沒有覆蓋整顆芯片。換句話說，55%的密度提升和41%的功耗降低，只是「小試牛刀」——邏輯摺疊的全部潛力遠未被釋放。

技術路線的成長天花板還很高，遠未到瓶頸期。未來隨著混合鍵合間距縮小、摺疊覆蓋率提升，性能提升空間仍然巨大。

要點三：一條明確的「四年路線圖」

V2首次披露了未來四代麒麟處理器和昇騰AI芯片的具體性能目標。論文預計，到2035年，AI硬件整體集成度有望較2026年提升100倍以上。

對投資者而言，這意味著：這不是一次性的技術突破，而是一條有明確時間表的持續升級路徑。對於產業鏈上的設備、材料、封測、EDA等環節，這意味著長週期的訂單能見度。

（3D堆疊與混合鍵合的實物結構）

三、韜定律如何重塑AI資本開支邏輯？

韜定律V2的發布，恰逢全球AI資本開支正處於歷史級擴張週期。兩者疊加，正在形成一個全新的投資敘事框架。

AI算力的核心痛點，正是韜定律要解決的問題。

何庭波在論文中指出，在一個大型AI集羣中，超過80%的能源消耗於數據移動；超過70%的系統成本用於數據存儲。減少數據在傳輸途中的時間——在芯片間、機架間以及封裝內部——至少與減少計算本身的時間同等重要。韜定律通過系統架構創新（統一總線）、光互連（Hi-ONE）以及封裝拓撲重構（3D摺疊）三個層級協同實現τ縮放，使大規模AI集羣能夠像一個單一邏輯實體一樣協同運行。

全球半導體資本開支正在被AI重塑。 開源證券研報指出，AI基建正在驅動全球半導體開啟多年擴產週期，預計2026年全球IDM與代工廠資本開支達2720億美元，2024至2030年存儲、邏輯賽道複合增速分別達15.7%、11.4%。其中全球先進封裝規劃投資規模達1250億美元，存儲頭部廠商擴產增速領跑。

華為明確以混合鍵合為核心的3D邏輯摺疊工程路徑。麒麟2026在同工藝節點下實現晶體管密度提升55%、等性能功耗降低41%，同時披露了2026至2029年四代芯片演進路線。這一技術路徑將加速國內混合鍵合、TSV、晶圓減薄等先進封裝設備與材料的驗證導入及國產替代。

（「τ Law LogicFolding」路徑圖）

四、市場反應：資金正在用腳投票

韜定律V2發布後，資本市場反應迅速。

資金層面， $AI人工智能ETF平安(512930)$ 近3日獲得連續資金淨流入，合計「吸金」2.20億元，日均淨流入達7342萬元。 $半導體E(159558)$ 近三月合計「吸金」74.3億元，居同標的產品首位。

產業層面，全球半導體擴產週期方興未艾。7月4日， $美光科技(MU)$ 啟動廣島工廠擴建，總投資1.5萬億日元（約93億美元），生產HBM等AI存儲芯片，預計2028年夏季出貨。韓國以5760億美元押注AI存儲，體現了AI時代對存儲的國家級押注。

機構層面，銀河證券研報認為，全球AI資本開支仍在擴張週期，半導體設備行業需求保持高景氣。申港證券指出，華為韜定律將現有先進封裝和混合鍵合、光互聯等工藝與架構、材料等創新結合，為半導體性能提升提供了新的路線，利好國產晶圓代工廠、先進封裝測試、鍵合等半導體設備、EDA和光通信等環節。

五、投資啟示：三條主線值得關注

結合韜定律V2的技術路徑與全球AI資本開支趨勢，以下三條主線值得關注：

主線一：先進封裝設備與材料

韜定律的核心落地路徑是3D邏輯摺疊，依賴混合鍵合、TSV、晶圓減薄等先進封裝技術。全球先進封裝規劃投資已達1250億美元。混合鍵合、TSV等設備和材料環節，是韜定律從理論走向量產的「關鍵工具」。

主線二：EDA工具鏈

機構研報指出，EDA工具鏈對邏輯摺疊推廣至關重要，是邏輯摺疊的最大增量機遇。邏輯摺疊從「宏塊級離散優化」轉向「單元級連續優化」，對EDA工具提出了全新的設計要求。

主線三：AI算力硬件產業鏈

韜定律在AI算力端的落地，將通過Unified Bus統一總線、Hi-ONE光引擎等技術持續推進。全球雲服務商資本開支仍在擴張週期，GPU、HBM、服務器、光模塊等硬件鏈條持續受益。

總結

韜定律V2的發布，標誌著一項中國原創的半導體產業理論正式進入了工程實證階段。

從5月V1的「概念提出」到7月V2的「硅片實證」，前後不到兩個月。麒麟2026的55%晶體管密度提升、41%功耗降低——這些實測數據不僅驗證了一條技術路線，更為全球AI資本開支提供了一個全新的估值錨點：在不依賴極致製程的前提下，通過系統級架構創新，AI算力硬件仍然存在巨大的性能提升空間。

當摩爾定律放緩成為行業共識，韜定律正在為全球半導體產業提供第二條曲線。 而這條曲線的落地，正在驅動一輪全新的資本開支週期——從先進封裝到EDA工具，從混合鍵合設備到AI算力硬件，產業鏈的每一個環節都在被重新定價。

7月17日，2026世界人工智能大會（WAIC）將在上海舉行，華為昇騰將集中展示最新產品。

韜定律的故事，才剛剛開始。[Evil]

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